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        FPGA系統(tǒng)設(shè)計初級班培訓(xùn)課程主要幫助學(xué)員盡快掌握 CPLD/FPGA 的開發(fā)流程和設(shè)計方法，以工程實踐為例，循序漸進的學(xué)習(xí)FPGA的集成開發(fā)環(huán)境，開發(fā)流程以及硬件電路設(shè)計等知識。每次課程都配有相關(guān)實戰(zhàn)訓(xùn)練，每個實戰(zhàn)訓(xùn)練題目都可以在Cyclone(颶風(fēng)系列)的FPGA硬件平臺上進行下載驗證。通過實戰(zhàn)，學(xué)員可以更好的理解消化課堂知識，工程實踐水平會得到迅速提高。

        培養(yǎng)學(xué)員迅速掌握和使用CPLD/FPGA數(shù)字系統(tǒng)開發(fā)工具、開發(fā)流程，能夠獨立進行初步的FPGA系統(tǒng)設(shè)計。經(jīng)過培訓(xùn)，學(xué)員可以掌握HDL語言的初步開發(fā)能力。

        FPGA系統(tǒng)的軟件和硬件開發(fā)工程師；電子類專業(yè)的大學(xué)生和研究生；電子產(chǎn)品設(shè)計愛好者。

        學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識：
        ◆電路系統(tǒng)的基本概念。

　　　同時報選《FPGA應(yīng)用設(shè)計高級班》，即享受優(yōu)惠!

        1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓(xùn)班中重聽；
        2、培訓(xùn)結(jié)束后免費提供一個月的技術(shù)支持，充分保證培訓(xùn)后出效果；
        3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機會。

◆【陳老師】

資深FPGA開發(fā)工程師,FPGA培訓(xùn)課程金牌講師，有8年的FPGA和DSP系統(tǒng)硬件開發(fā)經(jīng)驗,近4年來一直從事視頻和圖像處理領(lǐng)域的高速DSP系統(tǒng)硬、軟件和FPGA系統(tǒng)的設(shè)計和開發(fā)，具有非常豐富的高速系統(tǒng)設(shè)計經(jīng)驗，精通TI公司的C6000系列高速DSP和Altera公司的全系列FPGA/CPLD。

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第一階段

    第一階段的課程主要幫助學(xué)員了解FPGA系統(tǒng)設(shè)計的基礎(chǔ)知識，掌握FPGA小系統(tǒng)硬件電路設(shè)計方法，學(xué)會操作QuartusII軟件來完成FPGA的設(shè)計和開發(fā)。

1.可編程邏輯設(shè)計技術(shù)簡介
2.可編程邏輯設(shè)計開發(fā)要點
3.可編程邏輯器件硬件
4.EDA軟件設(shè)計方法及發(fā)展趨勢
5.FPGA的設(shè)計流程
6.FPGA的常用開發(fā)工具
7.FPGA的基本結(jié)構(gòu)
8.主流低成本FPGA Cyclone
9.新一代低成本FPGA Cyclone II
10.FPGA芯片的選型策略詳解
11.FPGA關(guān)鍵電路的設(shè)計（小電路設(shè)計）：
    11.1 FPGA管腳約束
    11.2 要點
    11.3 關(guān)鍵
    11.4 字符型液晶顯示器接口電路設(shè)計
    11.5 技巧
    11.6 撥碼開關(guān)設(shè)計
    11.7 撥碼開關(guān)電路設(shè)計 
    11.8 數(shù)碼管電路設(shè)計
    11.9 圖形液晶電路設(shè)計 
12.Alter FPGA的結(jié)構(gòu)
    12.1  Alter 高密度FPGA-Stratix的結(jié)構(gòu)、內(nèi)部邏輯單元及接口
    12.2  Alter 主流低成本FPGA-Cyclone,Cyclone II 的結(jié)構(gòu)、內(nèi)部邏輯單元及接口
    12.3  Alter FPGA的布線

1. 實戰(zhàn)一：在Altera的FPGA開發(fā)板上運行一個接口實驗程序-交通燈的設(shè)計實現(xiàn)，如何控制Red,Green,Yellow燈在南北東西各個方向的交替運作。

   訓(xùn)練課題：“交通燈的設(shè)計實現(xiàn)”
    實驗要點：
    1.1  Quartus II工程創(chuàng)建及屬性設(shè)置
    1.2  Quartus II源文件設(shè)計輸入方式
    1.3  Quartus II約束設(shè)計
    1.4  Quartus II工程編譯
    1.5  Quartus II仿真
    1.6  Quartus II硬件下載

第二階段

    熟練掌握硬件描述語言(Verilog HDL)是FPGA工程師的基本要求。通過本節(jié)課程的學(xué)習(xí)，學(xué)員可以了解目前流行的Verilog HDL語言的基本語法，掌握Verilog HDL語言中常用的基本語法。通過本節(jié)課程學(xué)習(xí)，學(xué)員可以設(shè)計一些簡單的FPGA程序，掌握組合邏輯和時序邏輯電路的設(shè)計方法。通過實戰(zhàn)訓(xùn)練，學(xué)員可以對Verilog HDL語言有更深入的理解和認識。

1.Verilog HDL語言簡介
2.Verilog HDL語言邏輯系統(tǒng)
3.Verilog HDL操作數(shù)和操作符
4.Verilog HDL和VHDL語言的對比
5.Verilog HDL循環(huán)語句
6.Verilog HDL程序的基本結(jié)構(gòu)
7.Verilog HDL語言的數(shù)據(jù)類型和運算符
8.Verilog HDL語言的賦值語句和塊語，阻塞和非阻塞賦值語句的區(qū)別
9.Verilog HDL語言的條件語句，包括IF語句和CASE語句的典型應(yīng)用
10.Verilog HDL語言的其他常用語句
11.Verilog HDL語言實現(xiàn)邏輯電路

1. 實戰(zhàn)訓(xùn)練二：
   訓(xùn)練課題：“多路選擇器的設(shè)計”
    實驗要點：
    1.1  Quartus II軟件操作
    1.2  組合邏輯電路設(shè)計實現(xiàn)
    1.3  IF語句和CASE語句的使用
2. 實戰(zhàn)訓(xùn)練三：
   訓(xùn)練課題：“跑馬燈設(shè)計實現(xiàn)”
    實驗要點：
    2.1  Quartus II軟件操作
    2.2  時序邏輯電路設(shè)計實現(xiàn)
    2.3  分頻原理和實現(xiàn)方法
3. 實戰(zhàn)訓(xùn)練四：
   訓(xùn)練課題：“７段數(shù)碼管測試實驗-以動態(tài)掃描方式在８位數(shù)碼管“同時”顯示０-７”
   實驗要點：
    3.1  Quartus II軟件操作
    3.2  了解如何按一定的頻率輪流向各個數(shù)碼管的COM端送出低電平，同時送出對應(yīng)的數(shù)據(jù)給各段。
    3.3  介紹多個數(shù)碼管動態(tài)顯示的方法。

第三階段

    雖然利用第二階段課程學(xué)到的HDL基本語法可以完成大部分的FPGA功能，但相對復(fù)雜的FPGA系統(tǒng)設(shè)計中，如果能夠合理的應(yīng)用Verilog HDL的高級語法結(jié)構(gòu)，可以達到事半功倍的效果。通過第三天課程的學(xué)習(xí)，學(xué)員可以掌握任務(wù)（TASK），函數(shù)（FUNCTION）和狀態(tài)機的設(shè)計方法，可以更好的掌握FPGA的設(shè)計技術(shù)。此外，本節(jié)課程還介紹了QuartusII軟件的常用的高級工具－SignalTAP，可以提高FPGA設(shè)計和調(diào)試的效率。

1. TASK和FUNCTION語句的應(yīng)用場合
2. Verilog HDL高級語法結(jié)構(gòu)－任務(wù)（TASK）
3. Verilog HDL高級語法結(jié)構(gòu)－任務(wù)（FUNCTION）
4. 狀態(tài)機的設(shè)計原理及其代碼風(fēng)格
5. 邏輯綜合的原則以及可綜合的代碼設(shè)計風(fēng)格
6. SignalTap II在線邏輯分析儀使用方法

1. 實戰(zhàn)訓(xùn)練五：
   訓(xùn)練課題：“典型狀態(tài)機設(shè)計實例”
   實驗要點：
    1.1  FSM設(shè)計方法
    1.2  狀態(tài)機的編碼
    1.3  狀態(tài)機的初始化狀態(tài)和默認狀態(tài)（完整狀態(tài)機設(shè)計）
    1.4  狀態(tài)機的狀態(tài)定義風(fēng)格
    1.5  狀態(tài)機的編寫風(fēng)格
2. 實戰(zhàn)訓(xùn)練六：
   訓(xùn)練課題：“撥碼開關(guān)設(shè)計實驗”
   實驗要點：
    2.1  Quartus II輸入方式
    2.2  調(diào)試
    2.3 了解撥碼開關(guān)的工作原理及電路設(shè)計
3. 實戰(zhàn)訓(xùn)練七：
   訓(xùn)練課題：“矩陣鍵盤設(shè)計實驗”
   實驗要點：
    3.1  Quartus II原理圖輸入方式
    3.2 了解矩陣鍵盤的工作原理及電路設(shè)計