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◆招人、應(yīng)聘、人才合作，請把需求發(fā)到officeoffice@126.com或訪問曙海旗下網(wǎng)站--- 電子人才網(wǎng)： www.morning-sea.com.cn

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曙海招聘啟示

新招聘信息（2025年12月15日..以質(zhì)量求發(fā)展....合作共贏....實用實戰(zhàn)....用心服務(wù)..........--即將開課--........................(歡迎您垂詢，視教育質(zhì)量為生命！)）

機器視覺培訓

　　培訓班新動態(tài) 　

　　Virtuoso Chip Assembly Router培訓

入學要求

學員學習本課程應(yīng)具備下列基礎(chǔ)知識：
◆ 電路系統(tǒng)的基本概念。

班級規(guī)模及環(huán)境--熱線:4008699035 手機:15921673576/13918613812( 微信同號)

堅持小班授課，為保證培訓效果，增加互動環(huán)節(jié)，每期人數(shù)限3到5人。

上課時間和地點

上課地點：【上海】：同濟大學(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院【北京分部】：北京中山/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領(lǐng)館區(qū)1號（中和大道）【沈陽分部】：沈陽理工大學/六宅臻品【鄭州分部】：鄭州大學/錦華大廈【石家莊分部】：河北科技大學/瑞景大廈【廣州分部】：廣糧大廈【西安分部】：協(xié)同大廈
近開課時間(周末班/連續(xù)班/晚班）：Virtuoso Chip Assembly Router培訓：2025年12月15日..以質(zhì)量求發(fā)展....合作共贏....實用實戰(zhàn)....用心服務(wù)..........--即將開課--........................(歡迎您垂詢，視教育質(zhì)量為生命！)

實驗設(shè)備

　    ☆資深工程師授課


        ☆注重質(zhì)量
        ☆邊講邊練
        ☆合格學員免費推薦工作



        專注高端培訓17年，曙海提供的課程得到本行業(yè)的廣泛認可，學員的能力
        得到大家的認同，受到用人單位的廣泛贊譽。

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新優(yōu)惠

◆在讀學生憑學生證，可優(yōu)惠500元。

質(zhì)量保障

        1、培訓過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、課程完成后,授課老師留給學員手機和Email,保障培訓效果,免費提供半年的技術(shù)支持。
        3、培訓合格學員可享受免費推薦就業(yè)機會。

　　Virtuoso Chip Assembly Router培訓

培訓方式以講課和實驗穿插進行

課程描述：

Virtuoso Chip Assembly Router Course Description

This course explores the basic design flow for device-level and chip-level routing with?Virtuoso Chip Assembly Router. You will focus on methods of solving typical problems?while routing a top-level block design.

The highlights of this class include the following:

Learn about available translators for the Virtuoso Chip Assembly Router
Find, analyze, and solve typical problems
Explore component placement techniques
Understand routing techniques (automatic and interactive)
Create rules for clearance, timing, and noise
Explore power routing capabilities
Route device-level designs
Route a chip-level design

Audience

DSM Designers
Chip Designers
The primary audience includes experienced chip assembly users who are interested in improving block and chop assembly routing techniques for their design flows

Prerequisites

Students should already have knowledge of:

Virtuoso Layout Editor
Virtuoso XL Layout Editor

Students should have practical experience with:

UNIX OS

Course Agenda

Introduction
Preparing and translating data
Virtuoso Chip Assembly Router environment
Interactive placement
Interactive routing
Using rules and levels
How the autorouter works
Creating device-level designs
Creating chip-assembly deisgner

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